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最大时间差流水线在ASIC设计中的应用
流水线 时间差 ASIC设计
2008/9/1
根据深亚微米集成电路技术的特点和现代ASIC设计的要求，本课题重点研究了最大时间差流水线电路单元在ASIC中的重用性，并尝试了通过提取电路单元的系统模型来适应设计重用的要求。 分析了深亚微米工艺下的电路延迟模型，重点考虑了寄生效应和连线延迟对电路延迟的影响，并将其用于单级和多级最大时间差流水线电路的延迟分析和时钟约束模型中。选择现代ASIC设计流程中电路优化这一环节，完成了一个独立于EDA平台的最...